FPGA

整数除法器的设计

2019-07-15 22:32发布

站内问答 / FPGA
4469 7 1508
主频在400Mhz，输入端可配置，最大128位，整数无符号除法（四舍五入），重点是在10个周期内算完。
友情提示: 此问题已得到解决，问题已经关闭,关闭后问题禁止继续编辑，回答。
7条回答
黑桃ACE
2019-07-16 18:41
128位。。。。这么大

一周热门 更多>