来看看这个语句

2019-03-25 10:29发布

站内问答 / FPGA
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always @ ( posedge CLK or negedge RST )
if(!RST)  count <= 13'd0;
else if(count == 13'd5208)  count <= 13'd0;
else if(Count_sig)         count <= count + 1'b1;
我把第三条语句和第四条语句位置对换，会产生不同的结果，
不知道是为什么？ 此帖出自小平头技术问答
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8条回答
jjjcmxz
2019-03-26 07:01
应该是有优先级的吧

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